~aldats/rsc

e81f771e4228ea8b665c12c66116748f9965b24b — aldats 1 year, 9 months ago master
first commit
A  => LICENSE +21 -0
@@ 1,21 @@
MIT License

Copyright (c) 2023 aldats

Permission is hereby granted, free of charge, to any person obtaining a copy
of this software and associated documentation files (the "Software"), to deal
in the Software without restriction, including without limitation the rights
to use, copy, modify, merge, publish, distribute, sublicense, and/or sell
copies of the Software, and to permit persons to whom the Software is
furnished to do so, subject to the following conditions:

The above copyright notice and this permission notice shall be included in all
copies or substantial portions of the Software.

THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT. IN NO EVENT SHALL THE
AUTHORS OR COPYRIGHT HOLDERS BE LIABLE FOR ANY CLAIM, DAMAGES OR OTHER
LIABILITY, WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE, ARISING FROM,
OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR OTHER DEALINGS IN THE
SOFTWARE.

A  => README.md +22 -0
@@ 1,22 @@
RSC
===
`rsc` is a 32-bit computer simulated in [Logisim][]. It was developed to
fulfill the course requirements of Computer Organization and Architecture, and
is capable of running programs written in a rudimentary 16-instruction 
assembly. If you are a student for this course, please see "License & Academic
Misconduct".

[Logisim]: <http://www.cburch.com/logisim/>

## Usage
The heart of the project is contained in `rsc.circ`; it contains the data path
and control unit. For demo purposes, three programs, `program1.txt`,
`program2.txt`, `program3.txt`, and their bytecode counterparts, are packaged 
in the repository. Load the any program of your choice into memory and enable
the computer's clock.

## License & Academic Misconduct
`rsc` is licensed under the MIT license. See `LICENSE` for details. This in
mind, any use of this project for the requisite class amounts to academic
misconduct. If you are student for the requisite class, use your head; do the
work yourself.

A  => RSC.png +0 -0
A  => programs/program1.txt +24 -0
@@ 1,24 @@
; aldats 
; CSCI [REDACTED]: Open Lab 08
; program1.txt
;
; Program subtracts `A` from `F` (performs `F - A`) and displays the 
; output.

JMP start

var1: A
var2: F

start:
	; Load first variable into R.
	LDAC var1
	MVAC		
	; Load second variable into ACC.
	LDAC var2

	; (F - A) and sent result, `5`, to OUTR.
	SUB
	OUT

	HALT

A  => programs/program1_bytecode.txt +13 -0
@@ 1,13 @@
v2.0 raw
00000005
00000004
0000000a
0000000f
00000001
00000002
00000003
00000001
00000003
00000008
00000007
00000000

A  => programs/program2.txt +81 -0
@@ 1,81 @@
; aldats 
; CSCI [REDACTED]: Open Lab 08
; program2.txt
;
; Program performs `A9 + 2B`, `A9 - 2B`, `A9 AND 2B`, `A9 OR 2B`,
; `ASHR A9`, `AF + 1`, and `NOT D1`; results of all operations are
; stored in separate addresses and output to `OUTR` at each step.

JMP start

; Operands
var1: A9
var2: 2B
var3: AF
var4: D1

; Storage addresses
sum: 00         ; `A9 + 2B = D4`
dif: 00         ; `A9 - 2B = 7E`
bool_prod: 00   ; `A9 AND 2B = 29`
bool_sum: 00    ; `A9 OR 2B = AB`
shifted: 00     ; `A9 >> 1 = 54`
increm: 00      ; `AF + 1 = B0`
notted: 00      ; `NOT D1 = FFFFFF2E`

start:
	; A9 + 2B
	LDAC var1
	MVAC
	LDAC var2
	ADD
	STAC sum
	OUT

	; A9 - 2B
	LDAC var2
	MVAC
	LDAC var1
	SUB
	STAC dif
	OUT
	
	; A9 AND 2B
	LDAC var1
	AND
	STAC bool_prod
	OUT

	; A9 OR 2B
	LDAC var1
	OR
	STAC bool_sum
	OUT

	; ASHR A9
	LDAC var1
	ASHR
	STAC shifted
	OUT

	; AF + 1
	LDAC var3
	INC
	STAC increm
	OUT

        ; Purely for demonstrative purposes; `ACC` should be `0`
        ; at this step.
        CLAC

	; NOT D1
	LDAC var4
	NOT
	STAC notted
	OUT

        ; Purely for demonstrative purposes; `ACC` should 
        ; contain `2B` at this step.
        MOVR

	HALT

A  => programs/program2_bytecode.txt +65 -0
@@ 1,65 @@
v2.0 raw
00000005
0000000d
000000a9
0000002b
000000af
000000d1
00000000
00000000
00000000
00000000
00000000
00000000
00000000
00000001
00000002
00000003
00000001
00000003
00000009
00000002
00000006
00000007
00000001
00000003
00000003
00000001
00000002
00000008
00000002
00000007
00000007
00000001
00000002
0000000c
00000002
00000008
00000007
00000001
00000002
0000000d
00000002
00000009
00000007
00000001
00000002
0000000e
00000002
0000000a
00000007
00000001
00000004
0000000a
00000002
0000000b
00000007
0000000b
00000001
00000005
0000000f
00000002
0000000c
00000007
00000004
00000000

A  => programs/program3.txt +74 -0
@@ 1,74 @@
; aldats
; CSCI [REDACTED]: Open Lab 08
;
; Program computes and outputs the Gray code representation of three 
; consecutive numbers, starting from `num`. The Gray code representation 
; of any binary number, `n`, is `n XOR (n >> 1)`. So, for the starting
; number `8`, the expected outputs are `12`, `13`, and `15` or `1100`,
; `1101`, and `1111` in Gray code representation, or `0xC`, `0xD`, and
; `0xF` in hexadecimal encoding of Gray code representation.

JMP start

num: 7          ; (Number - 1) to start conversion at. Given `7`, for
                ; example, the program will output the Gray codes for
                ; `8`, `9`, and `10` (`12`, `13`, and `15`).
counter: 3      ; Number of Gray codes to compute; counts down.
step: 1         ; Step to decrement `counter` by.

shifted: 0      ; Storage for `num >> 1`.

; No native XOR instruction, so manually do (A AND ~B) OR (~A AND B)
product1: 0 	; Storage for `num AND ~shifted`
product2: 0 	; Storage for `~num AND shifted`

start:
    ; Increment `num` by `1`.
    LDAC num
    INC
    STAC num

    ; Shift `num` to the right by 1; result is what we will XOR
    ; `num` by to yeild the Gray code.
    LDAC num
    ASHR
    STAC shifted
    CLAC

    ; Compute first half of XOR expression: (num AND ~shifted)
    LDAC num            ; Load `num` into `R`
    MVAC
    LDAC shifted        ; Load `shifted` into `ACC` and complement it.
    NOT
    AND                 ; Compute (num AND ~shifted) and save result.
    STAC product1
    CLAC

    ; Compute second half of XOR expression: (~num AND shifted)
    LDAC shifted	; Load `shifted` into `R`
    MVAC
    LDAC num            ; Load `num` into `ACC` and complement it.
    NOT
    AND	                ; Compute (~num AND shifted) and save result.
    STAC product2

    ; Compute whole XOR expression and output to `OUTR`.
    LDAC product1
    MVAC
    LDAC product2
    OR
    OUT

    ; Loop above instructions until `counter == 0`. Decrement by
    ; `step` at each loop.
    LDAC step
    MVAC
    LDAC counter
    SUB
    JMPZ stop

    STAC counter
    JMP start

stop:
    HALT

A  => programs/program3_bytecode.txt +57 -0
@@ 1,57 @@
v2.0 raw
00000005
00000008
00000007
00000003
00000001
00000000
00000000
00000000
00000001
00000002
0000000a
00000002
00000002
00000001
00000002
0000000e
00000002
00000005
00000001
00000002
00000003
00000001
00000005
0000000f
0000000c
00000002
00000006
00000001
00000005
00000003
00000001
00000002
0000000f
0000000c
00000002
00000007
00000001
00000006
00000003
00000001
00000007
0000000d
00000007
00000001
00000004
00000003
00000001
00000003
00000008
00000006
00000037
00000002
00000003
00000005
00000008
00000000

A  => src/PLDs.circ +2165 -0
@@ 1,2165 @@
<?xml version="1.0" encoding="UTF-8" standalone="no"?>
<project source="2.7.1" version="1.0">
  This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).

  <lib desc="#Wiring" name="0">
    <tool name="Splitter">
      <a name="facing" val="south"/>
    </tool>
    <tool name="Probe">
      <a name="facing" val="north"/>
      <a name="radix" val="16"/>
    </tool>
    <tool name="Constant">
      <a name="width" val="32"/>
      <a name="value" val="0x0"/>
    </tool>
  </lib>
  <lib desc="#Gates" name="1"/>
  <lib desc="#Plexers" name="2"/>
  <lib desc="#Arithmetic" name="3"/>
  <lib desc="#Memory" name="4">
    <tool name="ROM">
      <a name="contents">addr/data: 8 8
0
</a>
    </tool>
  </lib>
  <lib desc="#I/O" name="5"/>
  <lib desc="#Base" name="6">
    <tool name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
  </lib>
  <main name="PC_BUS"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
  </options>
  <mappings>
    <tool lib="6" map="Button2" name="Menu Tool"/>
    <tool lib="6" map="Button3" name="Menu Tool"/>
    <tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="6" name="Poke Tool"/>
    <tool lib="6" name="Edit Tool"/>
    <tool lib="6" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin">
      <a name="tristate" val="false"/>
    </tool>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate"/>
    <tool lib="1" name="AND Gate"/>
    <tool lib="1" name="OR Gate"/>
  </toolbar>
  <circuit name="PC_BUS">
    <a name="circuit" val="PC_BUS"/>
    <a name="clabel" val="PC_BUS"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(150,110)" to="(150,120)"/>
    <wire from="(150,110)" to="(190,110)"/>
    <wire from="(130,170)" to="(170,170)"/>
    <wire from="(170,130)" to="(170,170)"/>
    <wire from="(130,120)" to="(150,120)"/>
    <wire from="(170,130)" to="(190,130)"/>
    <wire from="(220,120)" to="(240,120)"/>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: PC_BUS"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(130,120)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t0"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(130,170)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="0" loc="(240,120)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="PC_BUS"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(220,120)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
  </circuit>
  <circuit name="AR_LD">
    <a name="circuit" val="AR_LD"/>
    <a name="clabel" val="AR_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(40,210)" to="(100,210)"/>
    <wire from="(40,360)" to="(160,360)"/>
    <wire from="(230,150)" to="(230,160)"/>
    <wire from="(60,100)" to="(60,110)"/>
    <wire from="(300,120)" to="(300,140)"/>
    <wire from="(100,130)" to="(100,210)"/>
    <wire from="(80,110)" to="(320,110)"/>
    <wire from="(40,160)" to="(80,160)"/>
    <wire from="(140,150)" to="(180,150)"/>
    <wire from="(370,110)" to="(370,140)"/>
    <wire from="(40,310)" to="(140,310)"/>
    <wire from="(140,150)" to="(140,310)"/>
    <wire from="(300,120)" to="(320,120)"/>
    <wire from="(280,140)" to="(300,140)"/>
    <wire from="(370,140)" to="(390,140)"/>
    <wire from="(370,160)" to="(390,160)"/>
    <wire from="(350,200)" to="(370,200)"/>
    <wire from="(350,110)" to="(370,110)"/>
    <wire from="(420,150)" to="(440,150)"/>
    <wire from="(100,130)" to="(250,130)"/>
    <wire from="(40,110)" to="(60,110)"/>
    <wire from="(120,200)" to="(330,200)"/>
    <wire from="(370,160)" to="(370,200)"/>
    <wire from="(160,170)" to="(180,170)"/>
    <wire from="(210,160)" to="(230,160)"/>
    <wire from="(230,150)" to="(250,150)"/>
    <wire from="(40,260)" to="(120,260)"/>
    <wire from="(80,110)" to="(80,160)"/>
    <wire from="(160,170)" to="(160,360)"/>
    <wire from="(120,200)" to="(120,260)"/>
    <wire from="(60,100)" to="(320,100)"/>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="0" loc="(40,260)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,160)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,110)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t0"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(210,160)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(350,200)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="1" loc="(420,150)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: AR_LD"/>
    </comp>
    <comp lib="0" loc="(40,360)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(280,140)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(440,150)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="AR_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(350,110)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="0" loc="(40,310)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(40,210)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t4"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="PC_LD">
    <a name="circuit" val="PC_LD"/>
    <a name="clabel" val="PC_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(180,140)" to="(180,270)"/>
    <wire from="(100,220)" to="(160,220)"/>
    <wire from="(270,140)" to="(270,150)"/>
    <wire from="(340,100)" to="(340,120)"/>
    <wire from="(120,100)" to="(120,120)"/>
    <wire from="(140,170)" to="(140,190)"/>
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    <comp lib="1" loc="(390,130)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(100,220)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(100,120)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t4"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="0" loc="(410,130)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="PC_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(250,150)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(100,170)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(100,320)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: PC_LD"/>
    </comp>
    <comp lib="1" loc="(320,130)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(320,190)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="0" loc="(100,270)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="PC_INC">
    <a name="circuit" val="PC_INC"/>
    <a name="clabel" val="PC_INC"/>
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    <comp lib="1" loc="(360,150)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="1" loc="(430,130)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,360)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(570,160)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,410)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,110)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,160)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,310)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,210)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(220,190)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="1" loc="(290,180)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(500,220)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="1" loc="(500,110)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,260)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(590,160)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="PC_INC"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: PC_INC"/>
    </comp>
  </circuit>
  <circuit name="DR_LD">
    <a name="circuit" val="DR_LD"/>
    <a name="clabel" val="DR_LD"/>
    <a name="clabelup" val="east"/>
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    <wire from="(480,300)" to="(500,300)"/>
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    <wire from="(40,270)" to="(120,270)"/>
    <wire from="(40,420)" to="(180,420)"/>
    <wire from="(180,230)" to="(310,230)"/>
    <wire from="(180,230)" to="(180,420)"/>
    <comp lib="1" loc="(340,120)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(340,240)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(570,220)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="DR_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(270,260)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="1" loc="(480,300)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="0" loc="(40,470)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(410,220)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(480,140)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="1" loc="(410,140)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,270)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,420)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(340,170)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,520)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,370)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,110)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="1" loc="(550,220)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,320)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: DR_LD"/>
    </comp>
    <comp lib="0" loc="(40,160)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,220)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t5"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="DR_BUS">
    <a name="circuit" val="DR_BUS"/>
    <a name="clabel" val="DR_BUS"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <comp lib="0" loc="(40,470)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,420)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(320,120)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: DR_BUS"/>
    </comp>
    <comp lib="1" loc="(250,260)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,220)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(480,140)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="DR_BUS"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="1" loc="(320,170)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(460,140)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="1" loc="(390,140)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,160)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t4"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(390,220)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(40,320)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,370)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,110)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(320,240)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,270)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="R_LD">
    <a name="circuit" val="R_LD"/>
    <a name="clabel" val="R_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(100,80)" to="(100,190)"/>
    <wire from="(80,110)" to="(80,140)"/>
    <comp lib="0" loc="(40,190)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: R_LD"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="0" loc="(230,90)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="R_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,90)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,140)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="1" loc="(140,110)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="1" loc="(210,90)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
  </circuit>
  <circuit name="S_LD">
    <a name="circuit" val="S_LD"/>
    <a name="clabel" val="S_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(80,120)" to="(80,150)"/>
    <comp lib="0" loc="(40,200)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d0"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,100)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(230,100)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="S_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(210,100)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="0" loc="(40,150)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(140,120)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: S_LD"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
  </circuit>
  <circuit name="ACC_CLR">
    <a name="circuit" val="ACC_CLR"/>
    <a name="clabel" val="ACC_CLR"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(80,80)" to="(100,80)"/>
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    <comp lib="1" loc="(130,90)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="0" loc="(40,90)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(40,140)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d11"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(150,90)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="ACC_CLR"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: ACC_CLR"/>
    </comp>
  </circuit>
  <circuit name="ALU_SEL">
    <a name="circuit" val="ALU_SEL"/>
    <a name="clabel" val="ALU_SEL"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(250,170)" to="(270,170)"/>
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    <comp lib="0" loc="(40,90)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(270,170)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="S1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,340)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d13"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,140)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d4"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,240)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d10"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,290)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d12"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,390)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d14"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(250,240)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="4"/>
    </comp>
    <comp lib="6" loc="(72,52)" name="Text">
      <a name="text" val="Circuit Name: ALU_SEL"/>
    </comp>
    <comp lib="0" loc="(270,100)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="S0"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,190)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d9"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,440)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d15"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="1" loc="(250,100)" name="OR Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="1" loc="(250,170)" name="OR Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="0" loc="(270,240)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="S2"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="ACC_BUS">
    <a name="circuit" val="ACC_BUS"/>
    <a name="clabel" val="ACC_BUS"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(50,190)" to="(110,190)"/>
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    <wire from="(290,120)" to="(310,120)"/>
    <wire from="(270,90)" to="(290,90)"/>
    <wire from="(270,140)" to="(290,140)"/>
    <wire from="(70,90)" to="(70,130)"/>
    <wire from="(340,110)" to="(360,110)"/>
    <wire from="(90,100)" to="(90,140)"/>
    <wire from="(90,100)" to="(240,100)"/>
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    <wire from="(150,170)" to="(170,170)"/>
    <wire from="(200,160)" to="(220,160)"/>
    <wire from="(220,150)" to="(240,150)"/>
    <wire from="(110,80)" to="(110,190)"/>
    <wire from="(50,240)" to="(130,240)"/>
    <wire from="(150,170)" to="(150,290)"/>
    <wire from="(110,80)" to="(240,80)"/>
    <comp lib="0" loc="(50,90)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(50,190)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(360,110)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="ACC_BUS"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(340,110)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(270,140)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(50,240)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: ACC_BUS"/>
    </comp>
    <comp lib="0" loc="(50,290)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d7"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(270,90)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(200,160)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(50,140)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t5"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="ACC_LD">
    <a name="circuit" val="ACC_LD"/>
    <a name="clabel" val="ACC_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(490,220)" to="(490,280)"/>
    <comp lib="0" loc="(40,470)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d10"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(470,280)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="1" loc="(470,150)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,670)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d15"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,520)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d12"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,320)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d4"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,170)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(540,210)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(560,210)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="ACC_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,570)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d13"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: ACC_LD"/>
    </comp>
    <comp lib="0" loc="(40,270)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(400,180)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,220)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,620)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d14"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,370)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d8"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,120)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,420)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d9"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(400,120)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(330,210)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="8"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
  </circuit>
  <circuit name="R_BUS">
    <a name="circuit" val="R_BUS"/>
    <a name="clabel" val="R_BUS"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(230,90)" to="(250,90)"/>
    <wire from="(230,110)" to="(250,110)"/>
    <wire from="(210,120)" to="(230,120)"/>
    <wire from="(160,140)" to="(160,350)"/>
    <wire from="(40,250)" to="(120,250)"/>
    <wire from="(100,110)" to="(180,110)"/>
    <wire from="(80,100)" to="(80,150)"/>
    <wire from="(60,80)" to="(60,100)"/>
    <wire from="(60,80)" to="(230,80)"/>
    <wire from="(40,150)" to="(80,150)"/>
    <wire from="(140,130)" to="(180,130)"/>
    <wire from="(100,110)" to="(100,200)"/>
    <wire from="(40,300)" to="(140,300)"/>
    <wire from="(80,100)" to="(180,100)"/>
    <comp lib="0" loc="(40,100)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,300)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d12"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,200)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d8"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,150)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d4"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(210,120)" name="OR Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="0" loc="(300,100)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="R_BUS"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,350)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d13"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 08"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: R_BUS"/>
    </comp>
    <comp lib="1" loc="(280,100)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,250)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d9"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="Z_LD">
    <a name="circuit" val="Z_LD"/>
    <a name="clabel" val="Z_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(30,130)" to="(50,130)"/>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: Z_LD"/>
    </comp>
    <comp lib="0" loc="(50,130)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="Z_LD"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="0" loc="(30,130)" name="Constant"/>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 09"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
  </circuit>
  <circuit name="IR_LD">
    <a name="circuit" val="IR_LD"/>
    <a name="clabel" val="IR_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(40,160)" to="(80,160)"/>
    <wire from="(80,120)" to="(80,160)"/>
    <wire from="(120,120)" to="(160,120)"/>
    <wire from="(60,100)" to="(60,110)"/>
    <wire from="(40,110)" to="(60,110)"/>
    <wire from="(80,120)" to="(100,120)"/>
    <wire from="(60,100)" to="(160,100)"/>
    <wire from="(190,110)" to="(210,110)"/>
    <comp lib="0" loc="(210,110)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="IR_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(40,160)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(190,110)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(120,120)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 09"/>
    </comp>
    <comp lib="6" loc="(65,53)" name="Text">
      <a name="text" val="Circuit Name: IR_LD"/>
    </comp>
    <comp lib="0" loc="(40,110)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t2"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="OUTR_LD">
    <a name="circuit" val="OUTR_LD"/>
    <a name="clabel" val="OUTR_LD"/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(160,100)" to="(160,110)"/>
    <wire from="(40,140)" to="(80,140)"/>
    <wire from="(80,110)" to="(120,110)"/>
    <wire from="(160,100)" to="(180,100)"/>
    <wire from="(140,110)" to="(160,110)"/>
    <wire from="(210,90)" to="(230,90)"/>
    <wire from="(100,80)" to="(100,190)"/>
    <wire from="(80,110)" to="(80,140)"/>
    <comp lib="6" loc="(108,21)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="1" loc="(140,110)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="6" loc="(42,35)" name="Text">
      <a name="text" val="Lab # CLA 09"/>
    </comp>
    <comp lib="0" loc="(40,190)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d7"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(210,90)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="0" loc="(40,90)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,140)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(71,50)" name="Text">
      <a name="text" val="Circuit Name: OUTR_LD"/>
    </comp>
    <comp lib="0" loc="(230,90)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="OUTR_LD"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="RAM_RW">
    <a name="circuit" val="RAM_RW"/>
    <a name="clabel" val="RAM_RW"/>
    <a name="clabelup" val="east"/>
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    </comp>
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    </comp>
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    </comp>
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    </comp>
    <comp lib="0" loc="(40,160)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t3"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,110)" name="Pin">
      <a name="tristate" val="false"/>
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    </comp>
    <comp lib="6" loc="(53,41)" name="Text">
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    </comp>
    <comp lib="1" loc="(250,180)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(400,230)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(470,120)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
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    </comp>
    <comp lib="0" loc="(40,360)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
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    </comp>
    <comp lib="1" loc="(330,140)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="4"/>
    </comp>
    <comp lib="1" loc="(400,120)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,260)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,460)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(119,27)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
  </circuit>
  <circuit name="RAM_EN">
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      <a name="tristate" val="false"/>
      <a name="label" val="t6"/>
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    </comp>
    <comp lib="6" loc="(119,27)" name="Text">
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    </comp>
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    </comp>
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      <a name="tristate" val="false"/>
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    </comp>
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    </comp>
    <comp lib="0" loc="(40,110)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(420,230)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(350,140)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="4"/>
    </comp>
    <comp lib="0" loc="(40,310)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,510)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,460)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,360)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(420,120)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,410)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(270,180)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,210)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(82,56)" name="Text">
      <a name="text" val="Circuit Name: RAM_EN"/>
    </comp>
    <comp lib="1" loc="(500,170)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="4"/>
    </comp>
    <comp lib="6" loc="(53,41)" name="Text">
      <a name="text" val="Lab # CLA 09"/>
    </comp>
  </circuit>
  <circuit name="SC_CLR">
    <a name="circuit" val="SC_CLR"/>
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    <comp lib="6" loc="(119,27)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(40,350)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,250)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(53,41)" name="Text">
      <a name="text" val="Lab # CLA 09"/>
    </comp>
    <comp lib="1" loc="(360,280)" name="NOR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="4"/>
    </comp>
    <comp lib="0" loc="(590,260)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="SC_CLR"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(500,360)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="1" loc="(290,210)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,200)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t7"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,150)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,100)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t4"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(82,56)" name="Text">
      <a name="text" val="Circuit Name: SC_CLR"/>
    </comp>
    <comp lib="1" loc="(500,170)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="0" loc="(40,300)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(430,170)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(360,190)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,400)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,500)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(270,320)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(360,120)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(430,260)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(570,260)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(430,100)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,450)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="DR_BUSv2">
    <a name="circuit" val="DR_BUSv2"/>
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    <comp lib="6" loc="(75,63)" name="Text">
      <a name="text" val="Circuit Name: DR_BUSv2"/>
    </comp>
    <comp lib="1" loc="(300,230)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(460,240)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="DR_BUS"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(370,200)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,380)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,230)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(230,80)" name="Text">
      <a name="text" val="Comment: Previous version of DR_BUS output high on t2 when it was uncessary,"/>
    </comp>
    <comp lib="1" loc="(300,300)" name="OR Gate">
      <a name="size" val="30"/>
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    </comp>
    <comp lib="1" loc="(370,280)" name="AND Gate">
      <a name="size" val="30"/>
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      <a name="size" val="30"/>
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    </comp>
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      <a name="size" val="30"/>
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    </comp>
    <comp lib="6" loc="(83,27)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats"/>
    </comp>
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      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,330)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(52,44)" name="Text">
      <a name="text" val="Lab # OLA 09"/>
    </comp>
    <comp lib="6" loc="(216,113)" name="Text">
      <a name="text" val="Do not know why it made it pass the graders, but it was causing problems."/>
    </comp>
    <comp lib="6" loc="(189,96)" name="Text">
      <a name="text" val=" causing a &quot;data conflict&quot; between the bus outputs of DR and PC. "/>
    </comp>
    <comp lib="1" loc="(440,240)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,280)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(77,131)" name="Text">
      <a name="text" val="DR_BUS v2 removes t2."/>
    </comp>
    <comp lib="0" loc="(40,480)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,180)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t4"/>
      <a name="labelloc" val="north"/>
    </comp>
  </circuit>
  <circuit name="SC_CLRv2">
    <a name="circuit" val="SC_CLRv2"/>
    <a name="clabel" val="SC_CLRv2"/>
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    <comp lib="6" loc="(53,24)" name="Text">
      <a name="text" val="aldats"/>
    </comp>
    <comp lib="0" loc="(500,190)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="label" val="SC_CLR"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,470)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="z"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(410,120)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(340,140)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,220)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t7"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(81,57)" name="Text">
      <a name="text" val="Circuit Name: SC_CLRv2"/>
    </comp>
    <comp lib="1" loc="(480,190)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="3"/>
    </comp>
    <comp lib="1" loc="(340,210)" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="6" loc="(53,41)" name="Text">
      <a name="text" val="Lab # CLA 09"/>
    </comp>
    <comp lib="0" loc="(40,170)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(410,280)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(410,190)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="1" loc="(270,230)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,270)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d1"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,420)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d6"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="6" loc="(238,75)" name="Text">
      <a name="text" val="Comments: SC_CLRv2 is equivalent to previous SC_CLR but without the clock input."/>
    </comp>
    <comp lib="0" loc="(40,320)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d2"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="1" loc="(340,300)" name="NOR Gate">
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    </comp>
    <comp lib="1" loc="(250,340)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(40,370)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="d5"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(40,120)" name="Pin">
      <a name="tristate" val="false"/>
      <a name="label" val="t4"/>
      <a name="labelloc" val="north"/>
    </comp>
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      <a name="facing" val="south"/>
    </tool>
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      <a name="facing" val="north"/>
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    </tool>
  </lib>
  <lib desc="file#custom_reg.circ" name="7"/>
  <lib desc="file#PLDs.circ" name="8"/>
  <main name="RSC"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
  </options>
  <mappings>
    <tool lib="6" map="Button2" name="Menu Tool"/>
    <tool lib="6" map="Button3" name="Menu Tool"/>
    <tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="6" name="Poke Tool"/>
    <tool lib="6" name="Edit Tool"/>
    <tool lib="6" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin">
      <a name="facing" val="south"/>
      <a name="tristate" val="false"/>
    </tool>
    <tool lib="0" name="Pin">
      <a name="output" val="true"/>
      <a name="tristate" val="false"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate">
      <a name="width" val="32"/>
      <a name="size" val="20"/>
    </tool>
    <tool lib="1" name="AND Gate">
      <a name="width" val="32"/>
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </tool>
    <tool lib="1" name="OR Gate">
      <a name="width" val="32"/>
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </tool>
  </toolbar>
  <circuit name="ALU">
    <a name="circuit" val="ALU"/>
    <a name="clabel" val="ALU"/>
    <a name="clabelup" val="north"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(480,420)" to="(480,490)"/>
    <wire from="(450,350)" to="(510,350)"/>
    <wire from="(450,410)" to="(510,410)"/>
    <wire from="(360,410)" to="(360,480)"/>
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    <wire from="(420,440)" to="(580,440)"/>
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    <wire from="(340,320)" to="(360,320)"/>
    <wire from="(340,410)" to="(360,410)"/>
    <wire from="(620,350)" to="(650,350)"/>
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    <wire from="(390,330)" to="(390,390)"/>
    <wire from="(450,350)" to="(450,410)"/>
    <wire from="(480,360)" to="(480,420)"/>
    <comp lib="0" loc="(420,490)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="S2"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="6" loc="(44,36)" name="Text">
      <a name="text" val="Lab # CLA 05"/>
    </comp>
    <comp lib="0" loc="(360,240)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="0" loc="(360,480)" name="Probe">
      <a name="facing" val="north"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="0" loc="(450,490)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="S1"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="0" loc="(620,280)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="6" loc="(56,54)" name="Text">
      <a name="text" val="Circuit Name: ALU"/>
    </comp>
    <comp lib="6" loc="(132,16)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(650,350)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="ALU_Out"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="2" loc="(600,350)" name="Multiplexer">
      <a name="width" val="32"/>
      <a name="enable" val="false"/>
    </comp>
    <comp loc="(530,320)" name="Arith_U"/>
    <comp loc="(530,380)" name="Logic_U"/>
    <comp lib="0" loc="(480,490)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="S0"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="0" loc="(340,320)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="A"/>
    </comp>
    <comp lib="0" loc="(340,410)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="B"/>
    </comp>
  </circuit>
  <circuit name="Logic_U">
    <a name="circuit" val="Logic_U"/>
    <a name="clabel" val="LU"/>
    <a name="clabelup" val="north"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(320,230)" to="(320,300)"/>
    <wire from="(320,390)" to="(320,460)"/>
    <wire from="(550,400)" to="(550,470)"/>
    <wire from="(570,290)" to="(570,360)"/>
    <wire from="(370,460)" to="(540,460)"/>
    <wire from="(490,310)" to="(490,340)"/>
    <wire from="(490,360)" to="(490,390)"/>
    <wire from="(360,430)" to="(460,430)"/>
    <wire from="(350,320)" to="(450,320)"/>
    <wire from="(350,360)" to="(450,360)"/>
    <wire from="(350,360)" to="(350,390)"/>
    <wire from="(320,300)" to="(360,300)"/>
    <wire from="(360,300)" to="(450,300)"/>
    <wire from="(360,340)" to="(450,340)"/>
    <wire from="(550,360)" to="(570,360)"/>
    <wire from="(570,360)" to="(590,360)"/>
    <wire from="(480,350)" to="(510,350)"/>
    <wire from="(320,390)" to="(350,390)"/>
    <wire from="(300,300)" to="(320,300)"/>
    <wire from="(300,390)" to="(320,390)"/>
    <wire from="(420,400)" to="(440,400)"/>
    <wire from="(490,360)" to="(510,360)"/>
    <wire from="(490,340)" to="(510,340)"/>
    <wire from="(480,430)" to="(500,430)"/>
    <wire from="(400,470)" to="(550,470)"/>
    <wire from="(360,300)" to="(360,340)"/>
    <wire from="(360,340)" to="(360,380)"/>
    <wire from="(350,320)" to="(350,360)"/>
    <wire from="(400,470)" to="(400,510)"/>
    <wire from="(480,310)" to="(490,310)"/>
    <wire from="(480,390)" to="(490,390)"/>
    <wire from="(500,370)" to="(510,370)"/>
    <wire from="(540,400)" to="(540,460)"/>
    <wire from="(360,380)" to="(440,380)"/>
    <wire from="(360,380)" to="(360,430)"/>
    <wire from="(370,460)" to="(370,510)"/>
    <wire from="(500,370)" to="(500,430)"/>
    <comp lib="0" loc="(300,390)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="B"/>
    </comp>
    <comp lib="0" loc="(300,300)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="A"/>
    </comp>
    <comp lib="0" loc="(320,230)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="1" loc="(480,310)" name="AND Gate">
      <a name="width" val="32"/>
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(400,510)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="S0"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="0" loc="(420,400)" name="Constant">
      <a name="width" val="5"/>
    </comp>
    <comp lib="0" loc="(530,380)" name="Splitter">
      <a name="facing" val="south"/>
    </comp>
    <comp lib="0" loc="(370,510)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="S1"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="0" loc="(320,460)" name="Probe">
      <a name="facing" val="north"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="2" loc="(550,360)" name="Multiplexer">
      <a name="select" val="2"/>
      <a name="width" val="32"/>
      <a name="enable" val="false"/>
    </comp>
    <comp lib="1" loc="(480,430)" name="NOT Gate">
      <a name="width" val="32"/>
      <a name="size" val="20"/>
    </comp>
    <comp lib="3" loc="(480,390)" name="Shifter">
      <a name="width" val="32"/>
      <a name="shift" val="ar"/>
    </comp>
    <comp lib="1" loc="(480,350)" name="OR Gate">
      <a name="width" val="32"/>
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="0" loc="(570,290)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="6" loc="(44,36)" name="Text">
      <a name="text" val="Lab # CLA 05"/>
    </comp>
    <comp lib="6" loc="(132,17)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="6" loc="(67,52)" name="Text">
      <a name="text" val="Circuit Name: Logic_U"/>
    </comp>
    <comp lib="0" loc="(590,360)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Logic_Out"/>
      <a name="labelloc" val="east"/>
    </comp>
  </circuit>
  <circuit name="Arith_U">
    <a name="circuit" val="Arith_U"/>
    <a name="clabel" val="AU"/>
    <a name="clabelup" val="north"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(250,510)" to="(310,510)"/>
    <wire from="(310,510)" to="(370,510)"/>
    <wire from="(480,230)" to="(480,300)"/>
    <wire from="(180,370)" to="(240,370)"/>
    <wire from="(310,380)" to="(310,510)"/>
    <wire from="(150,370)" to="(150,380)"/>
    <wire from="(240,480)" to="(240,490)"/>
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    <wire from="(210,280)" to="(330,280)"/>
    <wire from="(350,250)" to="(350,270)"/>
    <wire from="(220,520)" to="(220,540)"/>
    <wire from="(210,260)" to="(210,280)"/>
    <wire from="(250,480)" to="(250,510)"/>
    <wire from="(250,510)" to="(250,540)"/>
    <wire from="(290,300)" to="(330,300)"/>
    <wire from="(310,250)" to="(350,250)"/>
    <wire from="(240,490)" to="(240,520)"/>
    <wire from="(290,300)" to="(290,390)"/>
    <wire from="(150,380)" to="(240,380)"/>
    <wire from="(400,500)" to="(430,500)"/>
    <wire from="(450,300)" to="(480,300)"/>
    <wire from="(310,250)" to="(310,360)"/>
    <wire from="(150,430)" to="(150,470)"/>
    <wire from="(480,300)" to="(500,300)"/>
    <wire from="(130,370)" to="(150,370)"/>
    <wire from="(220,520)" to="(240,520)"/>
    <wire from="(150,380)" to="(150,430)"/>
    <wire from="(410,310)" to="(420,310)"/>
    <wire from="(280,390)" to="(290,390)"/>
    <wire from="(430,320)" to="(430,500)"/>
    <wire from="(130,280)" to="(210,280)"/>
    <wire from="(150,370)" to="(160,370)"/>
    <wire from="(230,390)" to="(240,390)"/>
    <wire from="(260,410)" to="(260,460)"/>
    <wire from="(240,490)" to="(370,490)"/>
    <wire from="(150,430)" to="(410,430)"/>
    <wire from="(410,310)" to="(410,430)"/>
    <comp lib="0" loc="(230,390)" name="Constant">
      <a name="width" val="32"/>
      <a name="value" val="0x0"/>
    </comp>
    <comp lib="0" loc="(130,280)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="A"/>
    </comp>
    <comp lib="0" loc="(150,470)" name="Probe">
      <a name="facing" val="north"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="1" loc="(310,360)" name="NOT Gate">
      <a name="facing" val="north"/>
      <a name="size" val="20"/>
    </comp>
    <comp lib="0" loc="(260,460)" name="Splitter">
      <a name="facing" val="south"/>
      <a name="appear" val="right"/>
    </comp>
    <comp lib="1" loc="(180,370)" name="NOT Gate">
      <a name="width" val="32"/>
      <a name="size" val="20"/>
    </comp>
    <comp lib="1" loc="(400,500)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </comp>
    <comp lib="2" loc="(280,390)" name="Multiplexer">
      <a name="select" val="2"/>
      <a name="width" val="32"/>
      <a name="enable" val="false"/>
    </comp>
    <comp lib="6" loc="(44,36)" name="Text">
      <a name="text" val="Lab # CLA 04"/>
    </comp>
    <comp lib="6" loc="(133,16)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="3" loc="(370,290)" name="Adder">
      <a name="width" val="32"/>
    </comp>
    <comp lib="0" loc="(130,370)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="B"/>
    </comp>
    <comp lib="0" loc="(250,540)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="S0"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="2" loc="(450,300)" name="Multiplexer">
      <a name="width" val="32"/>
      <a name="enable" val="false"/>
    </comp>
    <comp lib="0" loc="(480,230)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="0" loc="(220,540)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="S1"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="0" loc="(210,260)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="0" loc="(500,300)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="AU_out"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="6" loc="(63,52)" name="Text">
      <a name="text" val="Circuit Name: Arith_U"/>
    </comp>
  </circuit>
  <circuit name="SC">
    <a name="circuit" val="SC"/>
    <a name="clabel" val="SC"/>
    <a name="clabelup" val="south"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <comp lib="6" loc="(44,36)" name="Text">
      <a name="text" val="Lab # CLA 06"/>
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    <comp lib="0" loc="(430,280)" name="Pin">
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    </comp>
    <comp lib="0" loc="(490,420)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Clear"/>
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    </comp>
    <comp lib="0" loc="(350,360)" name="Constant">
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    </comp>
    <comp lib="0" loc="(460,360)" name="Constant"/>
    <comp lib="3" loc="(410,350)" name="Adder">
      <a name="width" val="3"/>
    </comp>
    <comp lib="0" loc="(540,350)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="width" val="3"/>
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      <a name="label" val="SEQ_out"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="6" loc="(132,17)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="4" loc="(500,350)" name="Register">
      <a name="width" val="3"/>
    </comp>
  </circuit>
  <circuit name="RSC">
    <a name="circuit" val="RSC"/>
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    </comp>
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    <comp lib="0" loc="(340,660)" name="Splitter">
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      <a name="fanout" val="3"/>
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    </comp>
    <comp lib="6" loc="(56,63)" name="Text">
      <a name="text" val="Circuit Name: RSC"/>
    </comp>
    <comp lib="0" loc="(580,150)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="Z"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="0" loc="(580,90)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="DR"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="5" loc="(710,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="4" loc="(500,210)" name="RAM">
      <a name="addrWidth" val="16"/>
      <a name="dataWidth" val="32"/>
    </comp>
    <comp lib="0" loc="(580,130)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="ACC"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp loc="(640,730)" name="Z_Reg"/>
    <comp lib="7" loc="(360,730)" name="OUTR"/>
    <comp lib="5" loc="(830,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="0" loc="(580,70)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="PC"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="0" loc="(50,110)" name="Clock">
      <a name="label" val="Primary Clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(620,240)" name="Constant">
      <a name="value" val="0x0"/>
    </comp>
    <comp lib="0" loc="(810,530)" name="Probe">
      <a name="facing" val="west"/>
      <a name="label" val="T"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="5" loc="(670,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="0" loc="(470,260)" name="Constant">
      <a name="facing" val="north"/>
      <a name="value" val="0x0"/>
    </comp>
    <comp lib="7" loc="(640,410)" name="IR"/>
    <comp lib="0" loc="(580,50)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="AR"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="7" loc="(500,330)" name="PC"/>
    <comp lib="0" loc="(810,550)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="D"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="5" loc="(910,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="5" loc="(870,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="5" loc="(790,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="6" loc="(47,46)" name="Text">
      <a name="text" val="Lab # OLA 09"/>
    </comp>
    <comp lib="5" loc="(630,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="6" loc="(54,25)" name="Text">
      <a name="text" val="aldats"/>
    </comp>
    <comp lib="0" loc="(580,30)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="BUS"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="5" loc="(750,230)" name="Hex Digit Display">
      <a name="bg" val="#00000000"/>
    </comp>
    <comp lib="0" loc="(580,110)" name="Probe">
      <a name="facing" val="west"/>
      <a name="radix" val="16"/>
      <a name="label" val="R"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="0" loc="(580,340)" name="Splitter">
      <a name="fanout" val="8"/>
      <a name="incoming" val="32"/>
      <a name="bit1" val="0"/>
      <a name="bit2" val="0"/>
      <a name="bit3" val="0"/>
      <a name="bit4" val="1"/>
      <a name="bit5" val="1"/>
      <a name="bit6" val="1"/>
      <a name="bit7" val="1"/>
      <a name="bit8" val="2"/>
      <a name="bit9" val="2"/>
      <a name="bit10" val="2"/>
      <a name="bit11" val="2"/>
      <a name="bit12" val="3"/>
      <a name="bit13" val="3"/>
      <a name="bit14" val="3"/>
      <a name="bit15" val="3"/>
      <a name="bit16" val="4"/>
      <a name="bit17" val="4"/>
      <a name="bit18" val="4"/>
      <a name="bit19" val="4"/>
      <a name="bit20" val="5"/>
      <a name="bit21" val="5"/>
      <a name="bit22" val="5"/>
      <a name="bit23" val="5"/>
      <a name="bit24" val="6"/>
      <a name="bit25" val="6"/>
      <a name="bit26" val="6"/>
      <a name="bit27" val="6"/>
      <a name="bit28" val="7"/>
      <a name="bit29" val="7"/>
      <a name="bit30" val="7"/>
      <a name="bit31" val="7"/>
    </comp>
    <comp lib="7" loc="(450,600)" name="ACC"/>
    <comp loc="(340,600)" name="ALU"/>
    <comp lib="7" loc="(370,410)" name="DR"/>
  </circuit>
  <circuit name="Decoder">
    <a name="circuit" val="Decoder"/>
    <a name="clabel" val="ID"/>
    <a name="clabelup" val="north"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(610,330)" to="(750,330)"/>
    <comp lib="0" loc="(390,590)" name="Pin">
      <a name="output" val="true"/>
      <a name="width" val="4"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Debug_Instruction"/>
    </comp>
    <comp lib="6" loc="(135,18)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(500,370)" name="Splitter">
      <a name="fanout" val="16"/>
      <a name="incoming" val="16"/>
      <a name="appear" val="right"/>
    </comp>
    <comp lib="6" loc="(47,37)" name="Text">
      <a name="text" val="Lab # CLA 07"/>
    </comp>
    <comp lib="2" loc="(540,540)" name="Decoder">
      <a name="facing" val="west"/>
      <a name="select" val="4"/>
      <a name="enable" val="false"/>
    </comp>
    <comp lib="2" loc="(400,360)" name="Multiplexer">
      <a name="facing" val="west"/>
      <a name="selloc" val="tr"/>
      <a name="width" val="16"/>
      <a name="enable" val="false"/>
    </comp>
    <comp lib="0" loc="(390,360)" name="Pin">
      <a name="output" val="true"/>
      <a name="width" val="16"/>
      <a name="tristate" val="false"/>
      <a name="label" val="D_Out"/>
    </comp>
    <comp lib="6" loc="(66,53)" name="Text">
      <a name="text" val="Circuit Name: Decoder"/>
    </comp>
    <comp lib="0" loc="(800,180)" name="Pin">
      <a name="facing" val="west"/>
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="IR_In"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="1" loc="(560,330)" name="NOR Gate">
      <a name="facing" val="west"/>
      <a name="size" val="30"/>
      <a name="inputs" val="28"/>
    </comp>
    <comp lib="0" loc="(770,180)" name="Splitter">
      <a name="facing" val="west"/>
      <a name="fanout" val="29"/>
      <a name="incoming" val="32"/>
      <a name="bit0" val="28"/>
      <a name="bit1" val="28"/>
      <a name="bit2" val="28"/>
      <a name="bit3" val="28"/>
      <a name="bit4" val="0"/>
      <a name="bit5" val="1"/>
      <a name="bit6" val="2"/>
      <a name="bit7" val="3"/>
      <a name="bit8" val="4"/>
      <a name="bit9" val="5"/>
      <a name="bit10" val="6"/>
      <a name="bit11" val="7"/>
      <a name="bit12" val="8"/>
      <a name="bit13" val="9"/>
      <a name="bit14" val="10"/>
      <a name="bit15" val="11"/>
      <a name="bit16" val="12"/>
      <a name="bit17" val="13"/>
      <a name="bit18" val="14"/>
      <a name="bit19" val="15"/>
      <a name="bit20" val="16"/>
      <a name="bit21" val="17"/>
      <a name="bit22" val="18"/>
      <a name="bit23" val="19"/>
      <a name="bit24" val="20"/>
      <a name="bit25" val="21"/>
      <a name="bit26" val="22"/>
      <a name="bit27" val="23"/>
      <a name="bit28" val="24"/>
      <a name="bit29" val="25"/>
      <a name="bit30" val="26"/>
      <a name="bit31" val="27"/>
    </comp>
    <comp lib="0" loc="(460,350)" name="Constant">
      <a name="facing" val="west"/>
      <a name="width" val="16"/>
      <a name="value" val="0x0"/>
    </comp>
  </circuit>
  <circuit name="Timer">
    <a name="circuit" val="Timer"/>
    <a name="clabel" val="TD"/>
    <a name="clabelup" val="north"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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    <wire from="(670,330)" to="(690,330)"/>
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    <wire from="(590,380)" to="(650,380)"/>
    <wire from="(700,350)" to="(700,450)"/>
    <comp lib="0" loc="(670,320)" name="Pin">
      <a name="facing" val="south"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Clock"/>
    </comp>
    <comp lib="6" loc="(66,53)" name="Text">
      <a name="text" val="Circuit Name: Timer"/>
    </comp>
    <comp lib="2" loc="(470,300)" name="Multiplexer">
      <a name="facing" val="west"/>
      <a name="width" val="8"/>
      <a name="enable" val="false"/>
    </comp>
    <comp lib="2" loc="(590,380)" name="Decoder">
      <a name="facing" val="west"/>
      <a name="select" val="3"/>
      <a name="enable" val="false"/>
    </comp>
    <comp lib="6" loc="(137,17)" name="Text">
      <a name="text" val="Group [REDACTED]: aldats &amp; [REDACTED]"/>
    </comp>
    <comp lib="0" loc="(520,310)" name="Constant">
      <a name="facing" val="west"/>
      <a name="width" val="8"/>
      <a name="value" val="0x0"/>
    </comp>
    <comp lib="6" loc="(47,37)" name="Text">
      <a name="text" val="Lab # CLA 07"/>
    </comp>
    <comp lib="0" loc="(550,290)" name="Splitter">
      <a name="fanout" val="8"/>
      <a name="incoming" val="8"/>
      <a name="appear" val="right"/>
    </comp>
    <comp lib="0" loc="(490,450)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Stop"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="0" loc="(700,450)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Clear"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp loc="(650,380)" name="SC">
      <a name="facing" val="west"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="0" loc="(450,300)" name="Pin">
      <a name="output" val="true"/>
      <a name="width" val="8"/>
      <a name="tristate" val="false"/>
      <a name="label" val="T_Out"/>
    </comp>
  </circuit>
  <circuit name="Z_Reg">
    <a name="circuit" val="Z_Reg"/>
    <a name="clabel" val="Z"/>
    <a name="clabelup" val="north"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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      <a name="label" val="ACC_in"/>
    </comp>
    <comp lib="0" loc="(660,370)" name="Pin">
      <a name="facing" val="west"/>
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      <a name="tristate" val="false"/>
      <a name="label" val="Z_out"/>
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    </comp>
    <comp lib="0" loc="(600,460)" name="Pin">
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      <a name="tristate" val="false"/>
      <a name="label" val="Load"/>
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    <comp lib="1" loc="(550,370)" name="NOR Gate">
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    </comp>
    <comp lib="6" loc="(47,46)" name="Text">
      <a name="text" val="Lab # OLA 07"/>
    </comp>
    <comp lib="6" loc="(67,63)" name="Text">
      <a name="text" val="Circuit Name: Z_Reg"/>
    </comp>
    <comp lib="0" loc="(610,410)" name="Constant">
      <a name="facing" val="north"/>
      <a name="value" val="0x0"/>
    </comp>
    <comp lib="7" loc="(620,370)" name="1-bitRegister"/>
    <comp lib="0" loc="(600,310)" name="Pin">
      <a name="facing" val="south"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(330,200)" name="Splitter">
      <a name="fanout" val="32"/>
      <a name="incoming" val="32"/>
      <a name="appear" val="right"/>
    </comp>
  </circuit>
  <circuit name="Control">
    <a name="circuit" val="Control"/>
    <a name="clabel" val="Control Unit"/>
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    </comp>
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      <a name="tristate" val="false"/>
      <a name="label" val="RAM_EN"/>
    </comp>
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    </comp>
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      <a name="tristate" val="false"/>
      <a name="label" val="ACC_BUS"/>
    </comp>
    <comp lib="6" loc="(54,25)" name="Text">
      <a name="text" val="aldats"/>
    </comp>
    <comp lib="0" loc="(270,110)" name="Pin">
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      <a name="output" val="true"/>
      <a name="tristate" val="false"/>
      <a name="label" val="IR_LD"/>
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    </comp>
    <comp lib="0" loc="(760,350)" name="Splitter">
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    </comp>
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      <a name="label" val="Z_LD"/>
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  <main name="Register"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
  </options>
  <mappings>
    <tool lib="6" map="Button2" name="Menu Tool"/>
    <tool lib="6" map="Button3" name="Menu Tool"/>
    <tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="6" name="Poke Tool"/>
    <tool lib="6" name="Edit Tool"/>
    <tool lib="6" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
    </tool>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate">
      <a name="size" val="20"/>
    </tool>
    <tool lib="1" name="AND Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </tool>
    <tool lib="1" name="OR Gate">
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </tool>
  </toolbar>
  <circuit name="Register">
    <a name="circuit" val="Register"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(570,360)" to="(570,400)"/>
    <wire from="(580,290)" to="(580,380)"/>
    <wire from="(600,370)" to="(600,380)"/>
    <wire from="(570,360)" to="(590,360)"/>
    <wire from="(580,380)" to="(600,380)"/>
    <wire from="(510,350)" to="(590,350)"/>
    <wire from="(620,350)" to="(670,350)"/>
    <comp lib="4" loc="(620,350)" name="Register">
      <a name="width" val="32"/>
    </comp>
    <comp lib="6" loc="(66,52)" name="Text">
      <a name="text" val="Circuit Name: Register"/>
    </comp>
    <comp lib="6" loc="(41,36)" name="Text">
      <a name="text" val="Lab # OLA 05"/>
    </comp>
    <comp lib="0" loc="(580,290)" name="Pin">
      <a name="facing" val="south"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Clock"/>
      <a name="labelloc" val="north"/>
    </comp>
    <comp lib="0" loc="(510,350)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Data_In"/>
    </comp>
    <comp lib="0" loc="(670,350)" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Data_Out"/>
      <a name="labelloc" val="east"/>
    </comp>
    <comp lib="6" loc="(47,20)" name="Text">
      <a name="text" val="aldats"/>
    </comp>
    <comp lib="0" loc="(570,400)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Load"/>
      <a name="labelloc" val="south"/>
    </comp>
  </circuit>
  <circuit name="BusRegister">
    <a name="circuit" val="BusRegister"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
    <wire from="(600,370)" to="(600,380)"/>
    <wire from="(570,360)" to="(590,360)"/>
    <wire from="(580,380)" to="(600,380)"/>
    <wire from="(690,410)" to="(710,410)"/>
    <wire from="(650,410)" to="(670,410)"/>
    <wire from="(560,350)" to="(590,350)"/>
    <wire from="(620,350)" to="(650,350)"/>
    <wire from="(650,290)" to="(710,290)"/>
    <wire from="(570,360)" to="(570,450)"/>
    <wire from="(680,420)" to="(680,450)"/>
    <wire from="(650,290)" to="(650,350)"/>
    <wire from="(650,350)" to="(650,410)"/>
    <wire from="(580,230)" to="(580,380)"/>
    <comp lib="0" loc="(560,350)" name="Pin">
      <a name="width" val="32"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Data_In"/>
    </comp>
    <comp lib="0" loc="(570,450)" name="Pin">
      <a name="facing" val="north"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Load"/>
      <a name="labelloc" val="south"/>
    </comp>
    <comp lib="4" loc="(620,350)" name="Register">
      <a name="width" val="32"/>
    </comp>
    <comp lib="1" loc="(690,410)" name="Controlled Buffer">
      <a name="width" val="32"/>